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试比较vErilog hDl的逻辑运算符,按位运算符和缩位...

不同点:逻辑运算符执行逻辑操作,运算结果是一位逻辑值0、1或x;按位运算符产生一个与位宽较长操作数相等宽的值,该值的每一位都是两个操作数按位运算的结果;缩位运算符则仅对一个操作数进行运算,并产生一位的逻辑值。 相同点:除了逻辑非(!...

逻辑操作符的结果是一位的,包括:逻辑与&&,逻辑或||,逻辑非! 关系操作符的结果是一位的,包括:大于>,大于等于>=,小于

!是逻辑运算符,如果操作位不只是一位数,应将操作数作为一个整体来对待,即如果操作数是全0.就相当于逻辑0,只要有一位是1,就相当于逻辑1.这里4‘b0101 相当于逻辑1,取反自然为0.建议你看一下王金明版的数字系统设计与verilogHDL(第三版)

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